乐彩网大乐透历史开奖数据

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                English

                SPW總線節點控制器

                OBT-SPW-T是乐彩网17500公司自主研制的遵循ECSS-E-ST-50-12C協議規範的航天設備間的高速數據總線的節點IP核。

                 

                   產品描述

                 

                OBT-SPW-T可以嵌入在航天子系統中,將航天子系統中與SPW網絡連接,保證航天子系統之間高速、實時、確定、可靠地進行數據交換。

                 

                   產品特性

                 


                1 OBT-SPW-T功能結構框圖

                 

                1. 主要特征:

                ?遵循ECSS-E-ST-50-12C規範(兼容ECSS- E-50-12A)

                ?可提供雙向全雙工、串行的高速spw鏈路網絡接口(2-200Mbits/s),支持配置遠程存儲訪問(RMAP)功能;

                ?硬件邏輯實現物理層(PHY)、信號層、字符層、交換層以及數據包層協議;

                ?高性能的AMBA總線與主機間的數據傳輸;

                ?支持點ぷ對點的鏈路以及路由交換網絡;

                ?物理╳層采用LVDS技術,使SPW具有良好的EMC特性和更高的傳輸速率。

                 

                主要功能:

                ?配置管理:負責對SPW終端節點的功能控制寄存器、節點狀態寄存器、鏈路地址、時鐘分頻寄存器、直接存〓儲訪問(DMA)通道控制寄存器等進行參數配置;

                ?PHY:對接收到的采用DS(Data-Strobe)方式傳輸的數■據進行恢復;

                ?鏈路接口控制狀態機:處理SPW鏈路的交換層協議,實現鏈路的正常連接、鏈路錯誤檢測、鏈路斷路恢復連接等功能;

                ?數據接收器:對經過PHY處理的數據進行進一步處理,實現信號層和字符▲層協議;

                ?遠程存儲訪問數接收器:接收遵守RMAP協議傳輸來的數據;

                ?遠程存儲訪問數發送器:發送遵守RMAP協議的數@據;

                ?直接存儲訪問:實現數據與主機之間的直接交換;

                ?數據發送器:將數據轉換為DS模式進行發送,實現信號層和字符◎層協議。

                 

                實例應用:

                      基於圖1中的結構,將主機接口替換為PCI接口,將直接存儲訪問替換為≡DPRAM,可以得到下圖2所示的應用結構。該方案為Orbita研發的基於PCI接口的Spacewire終端節點板卡〇EMBC1000-PCISPW

                 

                 

                2 EMBC1000-PCISPW功能結構框圖

                2. 資源利用№情況

                 OBT-SPW-T資源評估(1spw收發):

                1Spacewire收發消耗的資源,資源中的PLLSpaceWire收發端模塊使用的倍頻時鐘。

                Altera Cyclone III:

                 LE:             3,433

                 Memory bits:     3,712

                Xilinx Virtex2:

                     Slices  :  1,802

                     LUTs  :  2,794

                     Memory bits : 3,712(Block RAMs: 2)

                     Flip-Flops   :1,398

                Xilinx Virtex5:

                     Slices  :  801

                     LUTs  :  1,788

                     Memory bits : 3,712(18K Block RAMs: 2)

                     Flip-Flops   :2,218

                Actel  ProASIC3:

                     D-flip-flops(CORE)  :  3,143

                     Memory bits : 3,712 (Block: 2) 

                 

                   產品列表

                 

                #

                產品型號

                產品描述

                備註

                1

                 OBTIP-SPW-T-F

                 ASIC版本固核(ASIC網表)

                 /

                2

                 OBTIP-SPW-T-V

                 FPGA版本固核(FPGA網表)

                 /

                3

                 OBTIP-SPW-T-S

                 軟核(RTL源碼)

                 /


                4Mb 8Mb 16Mb 32Mb

                • Part Number Configuration Voltage Clock Rate / Access time Package Temperature SCD#
                  暫無記錄
                • Part Number Configuration Voltage Clock Rate / Access time Package Temperature SCD#
                  暫無記錄
                • Part Number Configuration Voltage Clock Rate / Access time Package Temperature SCD#
                  暫無記錄
                • Part Number Configuration Voltage Clock Rate / Access time Package Temperature SCD#
                  暫無記錄

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